VeoPlace框架利用视觉语言模型优化芯片布局

2026年10月，研究人员Ikechukwu Uchendu等人在arXiv发布VeoPlace框架。该框架利用视觉语言模型指导芯片宏单元布局优化，无需对基础布线器进行微调即可提升其性能。 VeoPlace通过进化搜索策略迭代优化模型建议。在10个基准测试中的9个上，该框架使ChiPFormer的全局半周长线长降低超过32%。在8个Superblue基准测试上，DREAMPlace性能提升最高达4.4%。 此项研究展示了基础模型在解决复杂物理设计问题方面的潜力，为利用智能工具进行电子设计自动化开辟了新方向。

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