MCTS-SFT框架优化Verilog生成：提升效率与准确率
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MCTS-SFT框架优化Verilog生成：提升效率与准确率
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AI 综述
2026年10月30日，arXiv发布题为“MCTS-SFT：通过搜索引导的推理轨迹优化Verilog生成”的论文。该框架通过蒙特卡洛树搜索优化Verilog生成的监督微调轨迹。
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最新进展10月30日 12:00
MCTS-SFT: 通过搜索引导的推理轨迹优化Verilog生成报道时间线
沿着报道，了解事件的不同侧面。
10月30日
- arXiv · AIMCTS-SFT: 通过搜索引导的推理轨迹优化Verilog生成
MCTS-SFT框架通过蒙特卡洛树搜索优化Verilog生成的监督微调轨迹。 Plan-MCTS将搜索限制在包含接口和时序的紧凑硬件设计计划中，84.2%的正确轨迹生成率优于未引导探索的82.0%。 在6000条轨迹研究中，该方法使VerilogEval-v2的pass@10提升最多3.7分，生成长度减少约50%。
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还没有足够的连续观测数据，暂不绘制趋势。