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LLM agent 设计 RISC-V 并经 FPGA 评估

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AI 综述

2026年10月30日，Leo Itoh 与 Junichiro Kadomoto 在 arXiv（cs.AI）发表论文，提出一种由 LLM agent 辅助设计 RISC-V CPU 并配合 FPGA 在环评估的开发环境。该环境中，LLM agent 在 FPGA 上实现 CPU 候选项，并依据板上的性能测量数据来指导后续设计决策。论文展示了该方法如何推动核心架构的演进。在实验结果中，原本的单周期 RV32I 核心逐步发展为支持三发射乱序执行的 RV32IM 核心。论文同时开放了相关代码与数据以供验证。

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最新进展10月30日 12:00

LLM Agent 辅助 RISC-V CPU 设计与 FPGA 在环评估

报道时间线

沿着报道，了解事件的不同侧面。

10月30日

12:00
arXiv · AI
LLM Agent 辅助 RISC-V CPU 设计与 FPGA 在环评估
LLM Agent 在 FPGA 上实现 CPU 候选项并利用板载测量指导设计决策，最终单周期 RV32I 核心发展为三发射乱序 RV32IM 核心。

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