Hacker News AI· boldaxolotl·· 3 小时前AI 评分53
AI 智能体调试 RTL 芯片设计的难点及 Booley 框架优化实践
Why AI agents struggle with chip design (RTL) debugging, and what helps
AI 导读
Claude Code 在仅使用 Shell 时修复 Caliptra 中 RISC-V 核心 Bug 的平均耗时为 56 分钟,而使用开源 Booley 框架后缩短至 21 分钟。主要耗时源于硬件仿真周期长且内部信号不可见,导致智能体需反复猜测任务完成时间并手动添加调试打印。
来源:Hacker News AI · booley.dev